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【硬件测试】基于FPGA的8PSK+帧同步系统开发与硬件片内测试,包含高斯信道,误码统计,可设置SN

时间:2025/3/1 2:17:55 点击:

  核心提示:0sj2_065m,包括程序操作录像+参考文献...

1.完整项目描述和程序获取

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2.部分仿真图预览


3.算法概述

       8PSK调制是一种相位调制方式,其基本原理是通过改变载波的相位来传递信息。在8PSK中,一个符号周期内的相位变化有8种可能的状态,分别对应3个比特的信息。因此,8PSK调制可以看作是一种将3个比特映射到一个符号的映射方式。8PSK调制是一种相位调制方式,其基本原理是通过改变载波的相位来传递信息。在8PSK中,一个符号周期内的相位变化有8种可能的状态,分别对应3个比特的信息。因此,8PSK调制可以看作是一种将3个比特映射到一个符号的映射方式。

4.部分源码

`timescale 1ns / 1ps

//

// Company: 

// Engineer: 

// 

// Create Date: 2024/11/04 19:54:30

// Design Name: 

// Module Name: tops_hdw

// Project Name: 

// Target Devices: 

// Tool Versions: 

// Description: 

// 

// Dependencies: 

// 

// Revision:

// Revision 0.01 - File Created

// Additional Comments:

// 

//

 

 

module tops_hdw(

 

input i_clk,

input i_rst,

output reg [3:0] led

);

    

 

 

//产生模拟测试数据

wire o_msg;

wire[1:0]o_en;

signal signal_u(

.i_clk (i_clk),

.i_rst (~i_rst),

.o_bits(o_msg),

.o_en  (o_en)

);

 

 

//设置SNR

wire signed[7:0]o_SNR;

vio_0 your_instance_name (

  .clk(i_clk),                // input wire clk

  .probe_out0(o_SNR)  // output wire [7 : 0] probe_out0

);

 

wire[2:0]o_ISET;

wire signed[15:0]o_I8psk;

wire signed[15:0]o_Q8psk;

wire signed[15:0]o_Ifir_T;

wire signed[15:0]o_Qfir_T;

wire signed[31:0]o_mod_T;

wire signed[15:0]o_Nmod_T;

wire signed[31:0]o_modc_R;

wire signed[31:0]o_mods_R;

wire signed[31:0]o_Ifir_R;

wire signed[31:0]o_Qfir_R;

wire  [2:0]o_wbits;

wire       o_bits;

wire [1:0]o_bits_head;

wire [7:0]o_peak;

wire  o_en_data;

wire  o_en_pn;

wire  o_frame_start;

wire signed[31:0]o_error_num;

wire signed[31:0]o_total_num;  

 

TOPS_8PSK TOPS_8PSK_u(

.i_clk  (i_clk),

.i_rst  (~i_rst),

.i_SNR  (o_SNR),

.i_en   (o_en),

.i_dat  (o_msg),

.o_ISET (o_ISET),

.o_I8psk(o_I8psk),

.o_Q8psk(o_Q8psk),

.o_Ifir_T (o_Ifir_T),

.o_Qfir_T (o_Qfir_T),

.o_mod_T  (o_mod_T),

.o_Nmod_T(o_Nmod_T),

.o_modc_R (o_modc_R),

.o_mods_R (o_mods_R),

.o_Ifir_R (o_Ifir_R),

.o_Qfir_R (o_Qfir_R),

.o_wbits(o_wbits),

.o_bits (o_bits),

.o_bits_head(o_bits_head),

.o_peak(o_peak),

.o_en_data(o_en_data),

.o_en_pn(o_en_pn),

.o_frame_start(o_frame_start),

.o_error_num(o_error_num),

.o_total_num(o_total_num)

);

 

 

 

 

 

//ila篇内测试分析模块140

//ila篇内测试分析模块140

ila_0 ila_u (

.clk(i_clk), // input wire clk

.probe0({ 

        o_msg,o_SNR,o_I8psk[15:6],o_Q8psk[15:6],//30

        o_Nmod_T,o_Ifir_R[27:14],o_Qfir_R[27:14],o_wbits,//48

        o_error_num[15:0],o_total_num[23:0],//40

        //28

            o_en_pn,

            o_en_data,

            o_peak,

            o_bits_head,

            o_bits

         })

);

 

endmodule

0sj2_065m

---

作者:我爱C编程 来源:我爱C编程
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